【Verilog HDL等】ロジック設計、LSI検証◆大手!◆土日祝休み!
お仕事のポイント
◆1月スタート
◆大手SI企業勤務
◆論理設計経験活かせる
◆複数路線から通勤可、好立地オフィス
◆駅から徒歩圏内で通勤便利です
給与
時給
2,300 円交通費一部支給【月収例】
45万円以上(残業30時間の場合)
※お持ちのスキルやご経験等により給与条件は異なります。
※交通費別途支給。詳細はお問い合わせください。
勤務地
エリア
大阪府 / 大阪市中央区
最寄駅
大阪環状線 京橋駅(徒歩14分)JR東西線 大阪城北詰駅
期間・時間
勤務期間
長期
勤務開始
長期
勤務時間
就業時間:09:00~18:00(実働時間08時間)
月間想定残業時間:30~40時間程度
休日・休暇
土曜 日曜 祝日 週休2日制(土日祝休み)
仕事内容
設計(電気・電子・機械)<大手SI企業でのお仕事です>
Verilog HDLやVHDLなどのハードウェア記述言語を使用し、ロジックの設計を行っていただきます。また、動作確認の為の検証もお任せします。
【工程】
構想/仕様検討、詳細設計、図面作成、論理回路、論理設計
【環境】
Verilog HDL、VHDL、Synopsys/Cadenceツール
【測定器】
オシロスコープ
【企業情報】
回路設計、ファームウェアなどデバイス領域、OSやドライバーのミドルウェア領域、アプリケーション開発などを行っている大手企業です。
応募資格
実務経験1年以上/ブランク相談可/開始時期についてはご相談ください。
【活かせる経験・スキル】
■設計(電気)
■論理設計
■LSI(CMOS・DRAM等)
■VHDL
■Verilog
※3年前後ブランクのある方も、まずはご応募いただき、ご相談ください
「経験が浅くて心配…」「ブランクあっても大丈夫?」…など
スキルが不安な方は、まずお気軽に【キニナル】を!
勤務先の情報
職場の雰囲気
静かな環境のオフィスです
◆喫煙環境:禁煙(敷地内/屋内)
配属先部署
人数
(男6:女4)
概要
業界
IT・通信関連
応募・選考について
応募先
関西支社大阪府大阪市北区 梅田2-5-25
ハービスOSAKAオフィスタワー7F阪急京都線大阪梅田阪神「梅田駅」西改札より徒歩1分
明示すべき労働条件の詳細については派遣元企業との面談時にご確認ください。
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